PCIe 5.0技术特点

PCIe 5.0 基础规范v1.0正式版已在2019年发布，今年5.0 CEM规范v1.0版本刚刚定稿，目前5.0 PHY测试规范已更新到0.7版本。另外PCIe 6.0规范也在有条不紊指定当中，基础规范已到v0.7版，预计今年年内将发布v1.0版本。

PCIe 5.0带来了很多好处，同时也伴随着更多的挑战：
1
PCIe 5.0相较4.0速率及带宽翻倍，能够满足更高带宽的应用场合；
2
PCIe 5.0对信号完整性的要求苛刻，PCIe 5.0芯片、系统及板卡的设计及测试难度倍增；
3
PCIe 5.0端到端链路损耗-36dB @ 16GHz，需使用低损耗板材及根据链路设计需求考虑加入Re-timer芯片；
4
PCIe 5.0对参考时钟要求更高，规范增加了对系统主板参考时钟抖动测试要求。

从商用的角度，当前PCIe 4.0的产品已经大量商用，在2021年也有支持32 GT/s的PCIe 5.0 CPU平台和相关芯片发布，业内主要的服务器系统厂商已经投入前期研发和调试阶段，
2021年可以称之为PCIe 5.0商用元年，如何快速有效的对支持PCIe 5.0的各类接口芯片及板卡进行测试验证，以期将产品快速推向市场，抢占先机，成为各厂商面临的重要挑战。

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